目次
1 .绪论 · 1
1.1 数字通信系统介绍 · 1
1.2 信道编码介绍 2
1.3 卷积码的发展简介 3
1.4 本文的章节安排 4
2. 卷积码编译码原理 · 5
2.1 卷积码编码 5
2.2 卷积码 Viterbi 解码 8
2.2.1 网格图的表示方法 ·· 9
2.2.2 Viterbi 译码算法的具体步骤 1 0
2.3 小结 ·· 1 4
3 .卷积码编码的 MATLAB 仿真 · 1 5
3.1 软件仿真环境: MATLAB ·· 1 5
3.2 卷积码编码器仿真 ·· 1 6
3.3 Viterbi 解码器仿真程序 1 8
4. 卷积码编解码的 FPGA 实现 · 2 3
4.1 硬件实现环境: FPGA 及 Quartus II 设计流程 2 3
4.1.1 FPGA 发展历程 ·· 2 3
4.1.2 FPGA 基本原理与结构 ·· 2 3
4.1.3 FPGA 设计流程 ·· 2 5
4.1.4 Quartus II 设计流程 ·· 2 7
4.1.5 小结 ·· 2 9
4.2 卷积码编码器的 FPGA 实现 2 9
4.3 基于 IP 核的卷积码 Viterbi 解码部分 FPGA 实现 ·· 3 7
4.3.1 IP 核基本概念 ·· 3 7
4.3.2 Viterbi 译码器 IP 核的设置 · 3 8
5. 结果分析 ·· 4 8
5.1 输出结果方差、标准差的分析 ·· 4 8
5.2 Viterbi 解码特性的分析 5 0